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Trias Romania
 

PLM – FPGA Design / Verifikation - Kabelbaumentwurf
Die TRIAS Mikroelektronik GmbH, gegründet 1989, hat sich zu einem führenden Distributionsunternehmen entwickelt in den Bereichen EDA Tools (Electronic Design Automation), Product Lifecycle Management (PLM) Lösungen und ASIC Lösungen.

TRIAS ist fokussiert auf EDA Lösungen für das FPGA & IC Design und die – Verifikation, wie auch auf den Kabelbaumentwurf mit automatischer Dokumentenerstellung.

Unser Tochterunternehmen in Rumänien liefert für ost-europäische Kunden zusätzlich Lösungen für den PCB Entwurf (PADS / Expedition / Hyperlynx).

TRIAS ist seit 1999 der autorisierte Fachhändler der Mentor Graphics. Neben den Lösungen von Mentor Graphics bietet TRIAS komplementäre Produkte von innovativen Herstellern an, um aus einer Hand beziehend, durchgängige Lösungen anzubieten.

Neben Vertrieb und Marketing, unterstützen erfahrene Ingenieure der TRIAS unsere Kunden im technischen Support, in der Beratung und in weitere Dienstleistungen rund um unsere Lösungen.

TRIAS expandiert und wurde der Vertragspartner des amerikanischen ASIC Herstellers BaySand. BaySand liefert eine innovative ASIC Lösung, die die Vorteile von Gate Arrays und Standardzell-ASICs in ihre patentierte Technologie „Metal Configurable Standard Cell“ vereint.

BaySand entwarf ein innovatives Verfahren, um von komplexen FPGAs von ALTERA und XILINX auf die ASIC Plattform von BaySand zu migrieren. Dadurch wurde der Leistungsverbrauch reduziert und die Performance gesteigert.

 
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  • SystemVerilog – Advanced Verification for FPGA Design
    • 21.03. – 23.03.2017 in München
    • 16.05. – 18.05.2017 in Frankfurt (Main)
    • 18.07. – 20.07.2017 in München
    • 28.11. – 30.11.2017 in Frankfurt (Main)
    • Auf Anfrage auch andere Orte und Termine möglich.

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  • VHDL - 2008 / OSVVM
    • 07.03. – 08.03.2017 in München
    • 03.05. – 04.05.2017 in Frankfurt (Main)
    • 05.07. – 06.07.2017 in München
    • 15.11. – 16.11.2017 in Frankfurt (Main)
    • Auf Anfrage auch andere Orte und Termine möglich.

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  • Verilog for VHDL User
    • Termine und Orte auf Anfrage

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  • Accelerating FPGA and Digital ASIC Design
    • 24.10. - 25.10.2017 in München
    • 28.11. - 29.11.2017 in Frankfurt (Main)
    • Auf Anfrage auch andere Orte und Termine möglich.

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  • Accelerating FPGA VHDL Verification
    • 25.4. – 27.4.2017 in München
    • 30.5. – 1.6.2017 in Frankfurt (Main)
    • Auf Anfrage auch andere Orte und Termine möglich.

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  • Signal Integrity for Hardware Designer
    • 21.03. – 23.03.2017 in Berlin
    • 27.06. – 29.06.2017 in Stuttgart
    • 26.09. – 28.09.2017 in Berlin
    • 20.11. – 23.11.2017 in Stuttgart
    • Auf Anfrage auch andere Orte und Termine möglich.

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  • Signal Integrity: High-Speed Memory Interfaces
    • 07.03. – 08.03.2017 in Stuttgart
    • 13.06. – 14.06.2017 in Berlin
    • 12.09. – 13.09.2017 in Stuttgart
    • 07.11. – 08.11.2017 in Berlin
    • Auf Anfrage auch andere Orte und Termine möglich.

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